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毫米波雷达RISC-V国产抢跑
对雷达而言，是方案选择
文章来自：芯传感公众号
奕斯伟计算在港股上市，成为"RISC-V第一股"。其招股书坦言，“RISC-V仍处于市场验证的初期，用户认知与信任度尚未充分建立，还面临人才短缺。”
这轮热度的推力主要是供应链可控、成本与定制权、国际龙头（主要是英飞凌）转向。
但具体到毫米波雷达领域，最先采用RISC-V的是国内厂商。
🔺国产毫米波雷达芯片架构
国际巨头，会长期保有Arm和自有架构
2026年，TI在CES上发布了8发8收的AWR2188收发器，NXP发布了TEF8388、SAF8444，处理器仍是Cortex-A53和M7。
可以这样说，恩智浦、德州仪器等国外大厂在毫米波雷达处理器上，近年来基本没有动，短期内也不太可能主动打破自己的Arm生态。对这些厂商而言，现有Arm雷达芯片仍在持续产生商业回报，主动切换的动力不足，RISC-V对他们来说更像是远期储备。
国内厂商能比国际大厂更早采用RISC-V，主要是由于没有研发技术和长期生态积累的“包袱”，切换成本低，可以直接选新架构。
国内最先落地的，是对功耗和成本极度敏感、对认证审核相对宽松的消费场景。比如，24年发布，正和微芯的RS6240采用双核RISC-V架构，已用于智能家居、康养监护、安防预警等终端；开酷K60213内置RISC-V MCU与AI加速器，用于电视、空调、风扇等室内交互设备。
但对于更高要求的车规底层资质，国产行列也不乏挑战者。2026年，芯来NA900已获ISO 26262 ASIL-D认证，加特兰的Kunlun-Pro和Andes-Pro内置该内核，也在向L2 ADAS前向感知渗透。
加特兰：RISC-V用于后半程
加特兰6月发布的Kunlun-Pro内置芯来NA900内核，双发射双核总算力3668 DMIPS，约为上一代Alps-Pro的5倍。
它借RISC-V标准扩展接口，把排序、插值、三角函数等后处理操作做成硬件指令。
据加特兰测试，聚类耗时约减半，跟踪耗时减少超过50%。外界关注的10倍信号处理算力，来自自研的雷达信号处理器RSP 2.0，而不是RISC-V核。
RISC-V在这颗芯片里的角色是后处理的可定制处理器。通俗地说，雷达芯片的工作分两段：前一段把回波变成点云，后一段把点云整理还原成"一辆车、一个行人"这样的目标并持续跟踪，才要靠CPU跑软件。
这段算法更新快，不适合全部固化成电路，必须留在可编程的CPU上，而RISC-V开放的扩展接口正好允许厂商自己加指令。
对雷达而言，是方案选择
在毫米波雷达芯片里，CPU指令集（无论Arm还是RISC-V）不是决定性能的关键，重算力在DSP和硬件加速器上。 所以RISC-V与Arm在雷达领域是并存的选择关系，不是代际替代。厂商选RISC-V，驱动因素是供应链可控、成本和定制自由，而不是性能代差。
第二，功能安全不是短板， RISC-V IP早已具备ASIL-D能力，而雷达芯片本身的目标等级多在ASIL-B到ASIL-C之间；对雷达来说更漫长的是整芯片认证，通常要三到五年。
🔺获得ASIL D认证
可以这样说，2026年RISC-V在毫米波雷达里仍是CPU槽位上的第二选项，国产SoC先用上，国际龙头仍在MCU侧铺路。
这与部分企业决策者的判断一致，芯来创始人在RISC-V峰会上说：RISC-V不会取代x86和Arm，最终将形成三分天下的格局。加特兰创始人也在加特兰日上提到，“基于SoC的雷达端侧处理架构短期内仍是车企和Tier-1的主流选择”。
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